Полигон-2

Ну это видимо non-cacheable region в облвсти нижней памяти (разделяемую память
например адаптеров ISA/PCI часто нельзя кешировать, если они DMA пользуют).
Или memory hole 15-16MB. А при 128MB как показывает?

В любом случае, я думаю это неплохо, а вот если 512MB поставить, то да, будет ухудшение
производительности. Хочу предупредить, что для проверки надо ставить процессор без
встроенного L2 cache, тк с процессором K6-2+ / K6-3 (со своим кешем) CTCM показывает
настройки L2 в процессоре, а кеш на плате перестает распознавать.

На моей ASUS P5A R1.06 ситуация лучше, тк 512MB памяти кешируется в режиме WB (почти
идеальный вариант), тк tag 10bit, встроенный в чипсет. Но из-за моей любви к VIA чипсетам
(кроме чипсетов со встроенной графикой) - MVP3 все равно по мне много лучше.

Кстати, MVP3 поддерживает только 8-бит tag, и теоретический максимум при 2MB cache:
256MB WB / 512MB WT

А на VIA VPX/VP2/VP3 поддерживается 10-бит tag, и теоретический максимум при 2MB cache:
1024MB WB / 2048MB WT, что больше чем можно реально поставить памяти на плату.

Но для этого плата должна иметь две микросхемы tag (у второго используются только два
бита), к сожалению примеров таких плат я не знаю. Вы такие не встречали?

Точно последний 1MB, не первый? Вы какой программой смотрели?

На 5ALI61 какая ревизия у Вас (внешний тег стоит)? Если стоит, то должно кешироваться 128MB, если нет - 512.

Может не кешироваться в регионе от 640 до 1MB (а программа округлила), тогда на
DOS не особо повлияет. Может не кешироватья mem hole 15-16MB.

Собственно, для MVP3:
Device 0 Offset 55-54 - Non-Cacheable Region #1 ......... RW
15-3 Base Address - A>28:16>........................... default=0
As noted below, the base address must be a multiple
of the region size.
2-0 Range (Region Size)
000 Disable ...................................................default
001 64K
010 128K (Base Address A16 must be 0)
011 256K (Base Address A16-17 must be 0)
100 512K (Base Address A16-18 must be 0)
101 1M (Base Address A16-19 must be 0)
110 2M (Base Address A16-20 must be 0)
111 4M (Base Address A16-21 must be 0)
Preliminary Revision 1.0 July 23, 1998


Device 0 Offset 57-56 - Non-Cacheable Region #2 ......... RW
15-3 Base Address MSBs - A>28:16> ................default=0
As noted below, the base address must be a multiple
of the region size.
2-0 Range (Region Size)
000 Disable................................................... default
001 64K
010 128K (Base Address A16 must be 0)
011 256K (Base Address A16-17 must be 0)
100 512K (Base Address A16-18 must be 0)
101 1M (Base Address A16-19 must be 0)
110 2M (Base Address A16-20 must be 0)
111 4M (Base Address A16-21 must be 0)

Вы можете посмотреть что в регистрах 54-57, любым инструментарием для
чтения PCI, например DOS программа PCI.EXE

Для Ali конечно другие регистры.

Если это была плата на MVP3, то насколько помню, у Вас плата от
PCPartner с 512KB cache, тогда кешироваться будет 128MB, если WT,
или 64 WB

Я нашел фото Вашей платы в теме
http://www.phantom.sannata.ru/...a=do_print

Да, тег внешние, мост ревизии E. Она должна кешировать 128MB RAM,
и с 256 конечно будет замедление.


Rio444 написал:

[q]

Весь фокус в том, что после сокращения памяти до 128Мб всё стало на свои места.

[/q]

Ну да, так и будет.

Кстати плата мне нравится, приятная! Стабилизатор 3.3Vна радиаторе сильно греется?

i8088 написал:

[q]

[/q]

Видимо я ошибся, и материнка была на VP3.
Посмотрите, здесь http://members.home.nl/ddwhite/chipsets.htm
Около середины страницы, ближе к концу.

[q]

...including subtracting the size of the L2 from the top of cacheable RAM to get the true cacheable range...

[/q]